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Tech Q&A : 33

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Xilinx의 임베디드 비전 세미나 Part 2 : Surveillance

서*준 : zynq 인터럽트 반응시간과 인터럽트루틴에서 구현할 floating 연산시간이 어떻게 되나요, 이 floating 연산을 Vivado HLS을 사용해서 fpga logic으로 구현하는 것이 고속화에 유리한가요? floating 연산을 fpga logic으로 구현시 속도는 어느 정도인가요?

: zynq는 ARM cotex A9 및 NEON coprocessor를 갖고 있습니다. CPU의 플로팅 연산은 해당 CPU 및 프로세스와 동일 합니다. HLS를 이용하여 floating 연산을 FPGA로 구현하실 수 있으며, 알고리즘 별로 다르지만 병렬처리가 유리한 알고리즘의 경우 CPU로 처리하는 것보다 더 빠르게 처리 하실 수 있습니다.

Tech Q&A : 95

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데이터 컨버터 특강: SAR ADC와 델타 시그마 ADC 쉽게 활용하기

강*희 : TI에서 제공하는 SAR ADC의 최대bit수 및 최대스피드는 얼마나 되나요?

: 최대 20-bit, 약 4MSPS 입니다

이*승 : 실시간으로 아닐로그에서 디지털로 신호 전환시 버퍼링이 발생하지 않을까요?

: sar adc의 경우 us 내외의 conversion time을 생각하셔야 합니다. 거의 실시간으로 컨버팅 가능합니다

Tech Q&A : 66

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[Webcast Day]프로그래밍이 필요 없는 측정 자동화와 대량 데이터 분석을 위한 소프트웨어

송*호 : 대량 데이터 분석에서 다양한 데이터를 분석한다고 했는데, 분석에 대해 필요로 하는 조건이나 항목 등을 설정하고 진행하는 방식인가요? 실험 데이터만 있으면 분석이 가능하다는게 혁신적이네요.

: 기본적으로 다량의 측정 data를 하나의 저장소에 모아서 데이터 관리를 효율적으로 진행 하실 수있습니다.

박*영 : labview 와 차이점 또는 장점이 대해서 설명 부탁드립니다.

: 기본적인 차이점은 측정된 결과 파일을 가져오기 위해 프로그래밍이 필요없다는 장점이 있고, mobile 엑세스 지원이 가능하다는 점입니다. 자동화 측정의 경우 test flow기능을 이용하시면 훨씬 쉽게 구현이 가능합니다.

Tech Q&A : 88

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[Webcast Day]오토모티브 레이더 모듈 측정

강*학 : 우천시에도 문제가 없으면 RADAR와 병행해서 LIDAR를 사용하는 이유가 어떤것이 있을까요?

: LIDAR는 우천시에 활용이 어렵습니다. LIDAR는 RADAR 대비 장점은 주변 사물에대한 Resolution이 좋다는 것입니다. LIDAR는 주로 근거리 센싱에 활용 됩니다.

정*균 : 1G bandwidth 에서 4G bandwidth 까지 키운 이유는 데이타량 때문인가요?

: 측정되는 사물의 정확도를 높이기 위해서 입니다. 높을수록 더 정밀하게 분석할 수 있습니다.

Tech Q&A : 45

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[Webcast Day]오토모티브 디지털 측정 솔루션

이*승 : 측정 결과치를 비교하는 기능이 있나요?

: Scope 에서 측정 결과를 비교하는 방식은 다양하게 적용될 수 있습니다. Interface 의 규격의 Limit 치에 어느 정도 margin 을 가지고 있는지 확인하는 방법이 대표적일 것입니다. 이외에도 Signal 을 직접 manual 적으로 비교하실 수 있습니다.

강*학 : 많은 규격들을 Ethernet으로 대체하면 Data 충돌에 의한 지연이라든가 이런것들이 문제가 되지 않나요?

: Automotive 에 여전히 많은 Interface 들이 존재하는 이유가 안전 및 충돌 등의 고려가 있습니다. Ethernet 으로 그 방향을 잡아가며 기존의 규격들을 대체하고 있지만, 안정성이 요구되는 부분에서는 기존의 안정성 있는 interface 가 여전히 사용될 것입니다.

Tech Q&A : 20

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[Webcast Day]오실로스코프를 이용한 신호 및 전력 무결성 측정

임*환 : Pi측정자체가 힘든경우가 많은데요 pi측정을 고려한 board제작을위한 guide가 제공되는지 긍금합니다.

: Logic Analyzer에서 사용되는 Soft touch probe 같은 경우는 PCB 설계단에서부터 측정시 프로빙을 위한 조건을 반영해야 하므로 가이드가 이루어지는 것으로 알고있습니다만, PI 측정을 위해 제공되는 보드 설계 가이드는 별도로 없는것으로 알고 있습니다.

임*환 : Si에 비해 pi는 측정 자체가 힘든데요. Pi측정을 골려한 board제작을 위함 guide를 제공하는지 궁금합니다.

: PI 측정을 위해 제공되는 보드 설계 가이드는 별도로 없는것으로 알고 있습니다만 측정 관련 문제로 인한 고민이 있으시다면 담당 영업사원을 통해 문의 주시면 제가 아는선에서 최대한 자세히 도움을 드리고자 합니다.

Tech Q&A : 50

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[Webcast Day]USB Type-C 기술의 도전과제 및 측정 솔루션 업데이트

: Configuration Channel로 설정 되지 않은 CC가 Cable Power공급용이면, 케이블을 통한 전류 전압이 20V 5A아 이상이 되는건가요?

: 맞습니다. eMark Cable 이라고 불리는 USB Type-C Cable 이 있습니다. 제품규격에 따라 지원되는 Power 용량은 다릅니다.

김*열 : [질문] USB Type C 의 CC 는 케이블 길이에 따른 Power 손실은 없나요? 있다면 해결방안이나 길이의 권고사항이 있는지요?

: CC 는 속도가 300 Kbps 이기 때문에 Power 손실은 매우 작다고 할 수 있습니다.. 또한, USB Type-C 길이는 2m for USB 3.1 Gen1 speed 와 1m for USB 3.1 Gen2 speed 로 구분됩니다.

Tech Q&A : 79

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[Webcast Day]5G 주요 기술과 측정 솔루션 소개

김*열 : 5G에서 전력소모량이 많아 진다면, 개인용 IoT 기기에 적용하기 위한 Power Saving 기술 같은 것이 있나요?

: 네, IoT 기기의 경우 device 자체적으로 배터리 소모를 줄이기 위한 기술이 연구되고 있으며 네트워크 기술도 함께 연구 중입니다. 예를 들어 단말/기지국 간에 통신 주기를 길게하거나 배터리 소모가 작은 Waveform을 사용하는 기술입니다.

신*호 : 5G의 네트워크 분야에 유력한 주파수 대역이 어떻게 되나요?

: 현재 결정된 주파수는 6GHz 이하에서는 3.5GHz 대역외에 다수가 있으며 6GHz 이상은 현재 연구/시험 중이며 국내/일본/미국에서는 28GHz에 주력하고 있습니다.

Tech Q&A : 47

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인텔 FPGA, Quartus 디버깅 툴 활용하기

김*영 : SignalTap 추가에 관계없이 기존 로직 fitting 상태를 유지할 수 있는 방법은 없나요?

: 추가된 signalTap의 logic이 custom logic 영역과 유사하시다고 생각 하시면 됩니다.

: SignalTap은 불가능하고 SignalProbe는 가능한 기존 fitting 상태를 유지하고 Incremental Compile이 가능합니다.

이*광 : 본 제품이 가지는 가장 특이한 장점과 기억하면 유익한 것은 몇 가지로 요약한다면 어떻게 표현할수 있나요

: ISSP 기능은 실시간으로 리셋이나 키 버튼에 해당하는 부분을 외부에 하드웨어 없이 GUI형태로 줄수있으며, 시그널탭 로직 애널라이져의 기능은 사용자에게 실시간으로 보고싶은 시그널들을 툴에서 확인할수 있습니다.

김*현 : 로직 어낼라이저 인터페이스를 이용하여 FPGA 내부의 많은 테스트점을 관측하고자 할때, 실제 테스트점의 파형을 정확하게 관측하는 것으로 보장할 수 있나요? 예를 들면 동기 문제가 발생하지 않나요?

: SignalTapII는 사용자가 sampling clock을 지정하여, 각 레지스터를 monitoring하는 것입니다 SignalTapII를 추가한 design에 Timing slack이 없다면, 신호의 신뢰하실 수 있습니다.

박*원 : SignalTap 사용 시 Recommend하는 Memory Block 사용률이 있나요?? Memory Block은 충분한데 어느 기준 용량을 넘어서면 Logic이 이상하게 동작하는 경우가 종종 있는 것 같습니다

: Device의 구조나 Resource에 따라 다르지만, 일반적으로 FPGA에 Memory Block은 columm으로 구성되는데, 사용되는 RAM의 용량이 하나의 columm을 벗어나면, Timing이 안좋아 집니다. 메모리의 사용량은 적으면 적을 수록 이러한 상황을 예방할 수 있습니다. 즉, SignalTapII으로 디버깅하는 블럭은 최소한으로 구성하시는 것을 권장합니다.

: 보통 SignalTap에서 logic을 probe할 경우 probe clock base로 logic probe하며, clock의 risedge 시점에 data를 저장하게 됩니다. 따라서 고속의 data를 전송하는 부분에 대해서는 원하지 안는 값을 probe할 수 있습니다.

Tech Q&A : 90

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STM32 MCU external memory interface - 메모리를 확장하여 STM32 100% 활용하기

이*환 : QSPI FLASH에서는 프로그램을 직접 수행하려면 초기화과정만 내부 플래쉬에서 수행해 주면되는 건가요? 아니면 BOOT핀등의 하드웨어적인 구성이 필요한건가요?

: 내부 Flash에서 코드로 수행하시면 됩니다.

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